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Alban Bourge
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Documents
Identifiants chercheurs
- alban-bourge
- IdRef : 199376557
Présentation
**Current project**
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I currently work as a R&D ingineer at Atos. I am part of a hardware design teams involved in the EPI project (https://www.european-processor-initiative.eu/). More specifically, I develop part of a NoC that should be on a chip.
**Past Research**
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I was post-doctorate researcher in the SLS team of TIMA laboratory. I worked under the supervision of Frédéric Pétrot on ternary neural networks. More precisely, we designed special architecture for hardware acceleration that has state of the art characteristics for area, power consumption, throughput and accuracy.
I obtained my PhD in TIMA laboratory, Grenoble, France in november, 2016. The topic is about context-switching hardware tasks running on FPGAs. For this purpose, I developed a plugin named CP3 [(available here)](http://tima.imag.fr/sls/research-projects/cp3/) for an HLS tool named AUGH [(see here for more information)](http://tima.imag.fr/sls/research-projects/augh/). A platform named VALZY, presented in conference, demontrates the validity of the flow. I worked under the supervision of Olivier Muller and Frédéric Rousseau.
**Teaching**
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### Ensimag (2013-2016)
http://ensimag.grenoble-inp.fr/
- [Computer architecture : numeric circuits and architectural basis](http://ensimag.grenoble-inp.fr/cursus-ingenieur/architecture-circuits-num-eacute-riques-et-eacute-l-eacute-ments-d-architecture-3mmarchi-412211.kjsp?RH=IMA_Enseignements "3MMARCHI")
32h/year - tutorials and lab work
- [Design and usage of processors](http://ensimag.grenoble-inp.fr/cursus-ingenieur/conception-et-exploitation-des-processeurs-3mmcep-385933.kjsp?RH=IMA_Enseignements "3MMCEP")
32h/year - supervised projects, tutorials and lab work
**Projet actuel**
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Je travaille actuellement en tant qu'ingénieur R&D chez Atos. Je fais partie d'une équipe d'architecture matérielle pour le projet EPI (https://www.european-processor-initiative.eu/). Je développe des éléments constitutifs d'un NoC qui doit aboutir à la fabrication d'une puce.
**Recherche passée**
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En post-doctorat dans l'équipe SLS du laboratoire TIMA en 2017, j'ai travaillé avec Frédéric Pétrot sur des réseaux de neurones ternaires. Plus particulièrement, nous avons mis au point des architectures neuronales pour accelerateur matériel qui présentent des caractéristiques à l'état de l'art en surface, consommation, débit et précision.
Avant cela, j'ai obtenu mon doctorat en novembre 2016. Le sujet de celui-ci concerne une technique de changement de contexte pour tâches matérielles s'éxectuant sur FPGA. Afin de démontrer l'utilité et la fonctionnalité de la technique mise au point, j'ai développé un outil appelé CP3 ([disponible ici](http://tima.imag.fr/sls/research-projects/cp3/)). CP3 est un plugin pour l'outil de synthèse de haut niveau AUGH ([visitez cette page pour plus d'informations](http://tima.imag.fr/sls/research-projects/augh/)). Une plateforme de démonstration, présentée en conférence, démontre la validité du flot de conception. J'ai travaillé sous la direction d'Olivier Muller et Frédéric Rousseau.
**Enseignement**
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### Ensimag (2013-2016)
http://ensimag.grenoble-inp.fr/
- [Architecture : circuits numériques et éléments d'architecture](http://ensimag.grenoble-inp.fr/cursus-ingenieur/architecture-circuits-num-eacute-riques-et-eacute-l-eacute-ments-d-architecture-3mmarchi-412211.kjsp?RH=IMA_Enseignements "3MMARCHI")
32h/an - TD, TP
- [Conception et exploitation des processeurs](http://ensimag.grenoble-inp.fr/cursus-ingenieur/conception-et-exploitation-des-processeurs-3mmcep-385933.kjsp?RH=IMA_Enseignements "3MMCEP")
32h/an - projet, TD, TP
Publications
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Generating Efficient Context-Switch Capable Circuits Through Autonomous Design FlowACM Transactions on Reconfigurable Technology and Systems (TRETS), 2016, 10 (1), pp.9. ⟨10.1145/2996199⟩
Article dans une revue
hal-01367798v2
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Prototyping dynamic task migration on heterogeneous reconfigurable systemsInternational Symposium on Rapid System Prototyping: Shortening the Path from Specification to Prototype, Oct 2017, Seoul, South Korea
Communication dans un congrès
hal-01971312v1
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Prototyping Dynamic Task Migration on Heterogeneous Reconfigurable Systems28th International Symposium on Rapid System Prototyping: Shortening the Path from Specification to Prototype (RSP 2017), Oct 2017, Seoul, North Korea. pp.16-22
Communication dans un congrès
hal-01744701v1
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La synthèse de haut niveau au service du changement de contexte matériel.Colloque National GDR SoC-SiP, 2016, Nantes, France
Communication dans un congrès
hal-01353497v1
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HLS-Based Methodology for Fast Iterative Development Applied to Elliptic Curve Arithmetic2016 Euromicro Conference on Digital System Design (DSD), 2016, Limassol, Cyprus. pp.511-518, ⟨10.1109/DSD.2016.51⟩
Communication dans un congrès
hal-01389247v1
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Demonstration of a context-switch method for heterogeneous reconfigurable systems2016 26th International Conference on Field Programmable Logic and Applications (FPL), Aug 2016, Lausanne, Switzerland. pp.1 - 1, ⟨10.1109/FPL.2016.7577384⟩
Communication dans un congrès
hal-01398560v1
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Flot de conception automatique pour circuits commutablesConférence d’informatique en Parallélisme, Architecture et Système (COMPAS 2016), Jul 2016, Lorient, France
Communication dans un congrès
hal-01353512v1
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A Novel Method for Enabling FPGA Context-Switch (Abstract Only)Proceedings of the 2015 ACM/SIGDA International Symposium on Field-Programmable Gate Arrays, 2015, Monterey, CA, USA, United States. pp.261--261, ⟨10.1145/2684746.2689096⟩
Communication dans un congrès
hal-01353496v1
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Automatic High-Level Hardware Checkpoint Selection for Reconfigurable SystemsField-Programmable Custom Computing Machines (FCCM'15), May 2015, Vancouver, Canada
Communication dans un congrès
hal-01164923v1
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Méthode de sélection de checkpoint matériel avec outil de synthèse de haut niveauJournées Nationales du Réseau Doctoral en Microélectronique (JNRDM'14), May 2014, Lille, France. pp.4
Communication dans un congrès
hal-01089685v1
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